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LTC1408-12
140812f
BLOCK DIAGRA
W
2
OGND
1
SD0
3
OVDD
3V
–
+
4
5
24
23
S & H
–
+
7
6
9
12 13
16
19
8
S & H
GND
EXPOSED PAD
VREF
10
F
CH0–
CH0+
CH1–
CH1+
–
+
10
11
S & H
–
+
14
15
S & H
CH2–
CH2+
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CH3+
–
+
17
18
S & H
–
+
20
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S & H
CH4–
CH4+
CH5–
CH5+
10
F
0.1
F
DGND
32
SCK
30
CONV
SEL2 SEL1 SEL0
THREE-
STATE
SERIAL
OUTPUT
PORT
MUX
2.5V
REFERENCE
TIMING
LOGIC
VCC
25
3V
VDD
1408 BD
600ksps
12-BIT ADC
12-BIT LATCH 5
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12-BIT LATCH 1
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26
27
BIP
29
28
31
22
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0.1
F
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